Intel QuickPath Interconnect: differenze tra le versioni
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== Caratteristiche tecniche ==
QPI rappresenta per molti versi l'alternativa Intel a [[HyperTransport]], standard di comunicazione utilizzato da [[Advanced Micro Devices|AMD]] nelle proprie architetture [[Athlon 64]], [[Opteron]] e [[Phenom]]. In realtà l'idea alla base di un BUS seriale non è stata
Le soluzioni precedenti basate sul tradizionale BUS di sistema ormai cominciavano a mostrare i loro limiti prestazionali soprattutto in ambito server e più precisamente in ambito [[multiprocessore]], dove ormai erano presenti veri e propri colli di bottiglia nella comunicazione tra le varie [[CPU]] e i [[chipset]]. Lo scopo primario del BUS QPI è quello di permettere al [[processore]] di comunicare direttamente con i vari altri componenti collegati alla [[motherboard]], beneficiando quindi di una [[banda passante]] maggiore e di latenze sempre più ridotte. La caratteristica peculiare di QPI è quella di essere una tecnologia di connessione "point-to-point" che elimina gli svantaggi portati da un solo BUS condiviso tra tutti i processori, il controller memoria e il controller [[I/O]]. Nella sua prima incarnazione, all'interno del [[core (Hardware)|core]] Bloomfield, QPI utilizza collegamenti da 6,4 Gigatransfers al secondo, per un'ampiezza di banda totale complessiva che può arrivare fino a 25 GB/s per ciascun collegamento (la metà, 12,8 GB/s, in ciascuna direzione); in altre parole, ogni processore presente nel sistema comunica con il chipset mediante un collegamento da 25 GB/s di banda passante. Va precisato che il BUS QPI è di tipo bidirezionale con un canale da 20 [[bit]] in ciascuna direzione; di questi 20 bit, solo 16 sono riservati al trasferimento effettivo dei dati da elaborare, mentre gli altri 4 vengono utilizzati come bit di parità, ovvero come codici di correzione dell'errore, in maniera analoga a come avviene nelle memorie [[RAM]] con [[Error-correcting code|ECC]].
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