「Intel Core i7」の版間の差分
削除された内容 追加された内容
編集の要約なし |
編集の要約なし |
||
81行目:
[[File:Intel core i7-975 top R7309725 wp.jpg|thumb|150px|Core i7 975]]
全プロセッサ共通事項:プロセスルールは 45nm。
* '''マイクロアーキテクチャ''' - Nehalem
* 命令セット拡張 - SSE4.1/4.2、テクノロジー - [[X64#Intel 64|Intel 64]]、[[NXビット|XD bit]]、[[インテル ターボ・ブースト・テクノロジー|TBT 1.0]]、[[Hyper-Threading|HT]]、[[SpeedStep|EIST]]、PCI Express 2.0 対応
* キャッシュ容量 (L1/L2/L3) - L1: (32KB+32KB)×4, L2: 256KB×4, L3: 8MB
186行目:
=== [[Westmereマイクロアーキテクチャ|Westmere]] 世代 ===
全プロセッサ共通事項:プロセスルールは 32nm。
* '''マイクロアーキテクチャ''' - Westmere
* '''対応ソケット''' - [[LGA1366]]
* 命令セット拡張 - SSE4.1/4.2、テクノロジー - Intel 64、XD bit、TBT 1.0、HT、EIST
235行目:
[[File:Intel CPU Core i7 2600K Sandy Bridge top.jpg|thumb|150px|Core i7 2600K]]
全プロセッサ共通事項:プロセスルールは 32nm。
* '''マイクロアーキテクチャ''' - Sandy Bridge
* 命令セット拡張 - SSE4.1/4.2 AVX、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 2.0 対応
* グラフィックス機能 - QSV/3D/CVT HD対応、API - DirectX 10.1、OpenGL 3.1
337行目:
=== [[Ivy Bridgeマイクロアーキテクチャ|Ivy Bridge]] 世代 ===
全プロセッサ共通事項:プロセスルールは 22nm。
* '''マイクロアーキテクチャ''' - Ivy Bridge
* 命令セット拡張 - SSE4.1/4.2 AVX、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
* グラフィックス機能 - QSV/3D/WiDi/CVT HD対応、API - DirectX 11.0、OpenGL 4.0
436行目:
[[File:Core i7-5820K IMGP5817 smial wp.jpg|thumb|150px|Core i7 5820K]]
全プロセッサ共通事項:プロセスルールは 22nm。
* '''マイクロアーキテクチャ''' - Haswell
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
* グラフィックス出力 - eDP/DP/HDMI/DVI/VGA、グラフィックス機能 - QSV/3D/WiDi/CVT HD対応、API - DirectX 11.1/11.2/12、OpenGL 4.0/4.3
596行目:
[[File:Intel i7 6800k cpu.jpg|thumb|150px|Core i7 6800K]]
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Broadwell
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、TBMT 3.0、HT、EIST、PCI Express 3.0 対応
* グラフィックス出力 - eDP/DP/HDMI/DVI/VGA、グラフィックス機能 - QSV/3D/WiDi/CVT HD対応、API - DirectX 11.2、OpenGL 4.3
726行目:
[[File:Intel CPU Core i7 6700K Skylake top.jpg|thumb|150px|Core i7 6700K]]
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
* グラフィックス出力 - eDP/DP/HDMI/DVI、グラフィックス機能 - 4K/QSV/3D/WiDi/CVT HD対応、API - DirectX 12、OpenGL 4.4
881行目:
=== [[Kaby Lakeマイクロアーキテクチャ|Kaby Lake]] 世代===
全プロセッサ共通事項:プロセスルールは 14nm<ref>{{Cite web|url=http://ark.intel.com/ja/products/family/95544/7th-Generation-Intel-Core-i7-Processor#@All|title=7th Generation Intel Core i7 Processors|accessdate=2017-01-22|publisher=Intel}}</ref>。
* '''マイクロアーキテクチャ''' - Skylake
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
* グラフィックス出力 - eDP/DP/HDMI/DVI、グラフィックス機能 - 4K/QSV/3D/WiDi/CVT HD対応、API - DirectX 12、OpenGL 4.4
965行目:
[[File:Intel i7 8700K.jpg|thumb|150px|Core i7 8700K]]
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
* '''対応ソケット''' - [[LGA1151|LGA1151v2]]
* 命令セット拡張 - SSE4.1,SSE4.2,AVX2、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
1,079行目:
=== [[Comet Lakeマイクロプロセッサ|Comet Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
* '''対応ソケット''' - [[LGA1200]]
* 命令セット拡張 - SSE4.1,SSE4.2,AVX2、テクノロジー - Intel 64、XD bit、TBT 3.0、HT、EIST、PCI Express 3.0 対応
1,145行目:
=== [[Rocket Lakeマイクロプロセッサ|Rocket Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Cypress Cove
* '''対応ソケット''' - [[LGA1200]]
* 命令セット拡張 - SSE4.1,SSE4.2,AVX2,AVX-512、テクノロジー - Intel 64、XD bit、TBT 3.0、HT、EIST、[[PCI Express]] 4.0 対応
1,210行目:
=== [[Alder Lakeマイクロプロセッサ|Alder Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは Intel 7。
* '''
** '''
** '''Eコア''' - Gracemont
* '''対応ソケット''' - [[LGA1700]]
* キャッシュ容量 (L1/L2/L3) - L1:80KB×8+96KB×4, L2: 1.25MB×8+2MB, L3: 25MB
* 発売日 -
;Alder Lake-S
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-S
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! colspan="2" |TDP (W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |型番
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
! rowspan="3" |PBP
! rowspan="3" |MTP
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|
| rowspan="5" |
| rowspan="5" |4 (4)
| rowspan="
| rowspan="2" |
| rowspan="2" |
| rowspan="2" |3.8
| rowspan="5" |12
| rowspan="5" |
| UHD 770
| 32
| 300 || 1500
| rowspan="
| rowspan="2" |190
| rowspan="
|-
|
| colspan="
|-
|[https://
| rowspan="2" |2.
| rowspan="2" |
| rowspan="2" |1.6
| rowspan="2" |3.6
| UHD 770
| 32
| 300 || 1500
| rowspan="2" |65
| rowspan="2" |180
|-
|[https://
| colspan="
|-
|[https://
| 1.
| 1.
| UHD 770
| 32
| 300 || 1500
| 35 || 99
|}
=== [[Raptor Lakeマイクロプロセッサ|Raptor Lake]] 世代 ===
1,533 ⟶ 1,506行目:
=== [[Nehalemマイクロアーキテクチャ|Nehalem]] 世代 ===
全プロセッサ共通事項:プロセスルールは 45nm。
* '''マイクロアーキテクチャ''' - Nehalem
* '''対応ソケット''' - Socket G1 ([[PGA988|rPGA988A]])
* 命令セット拡張 - SSE4.1/4.2、テクノロジー - [[X64#Intel 64|Intel 64]]、[[NXビット|XD bit]]、[[インテル ターボ・ブースト・テクノロジー|TBT 1.0]]、[[Hyper-Threading|HT]]、[[SpeedStep|EIST]]、PCI Express 2.0 対応
1,588 ⟶ 1,561行目:
=== [[Westmereマイクロアーキテクチャ|Westmere]] 世代 ===
全プロセッサ共通事項:プロセスルールは 32nm。
* '''マイクロアーキテクチャ''' - Westmere
* '''対応ソケット''' - Socket G1 ([[PGA988|rPGA988A]]) or オンボード ([[BGA1288]])
* 命令セット拡張 - SSE4.1/4.2、テクノロジー - Intel 64、XD bit、TBT 1.0、HT、EIST
1,665 ⟶ 1,638行目:
=== [[Sandy Bridgeマイクロアーキテクチャ|Sandy Bridge]] 世代 ===
全プロセッサ共通事項:プロセスルールは 32nm。
* '''マイクロアーキテクチャ''' - Sandy Bridge
* '''対応ソケット''' - [[Socket G2]] ([[PGA988|rPGA988B]]) or オンボード ([[BGA1224]] or [[BGA1023]])
* 命令セット拡張 - SSE4.1/4.2 AVX、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 2.0 対応
1,785 ⟶ 1,758行目:
[[File:Asus Zenbook UX32V - motherboard - Intel Core i7-3517U (SR0N6)-9632.jpg|thumb|150px|Core i7 3517U]]
全プロセッサ共通事項:プロセスルールは 22nm。
* '''マイクロアーキテクチャ''' - Ivy Bridge
* '''対応ソケット''' - [[Socket G2]] ([[PGA988|rPGA988B]]) or オンボード ([[BGA1224]] or [[BGA1023]])
* 命令セット拡張 - SSE4.1/4.2 AVX、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 2.0/3.0 対応
1,917 ⟶ 1,890行目:
=== [[Haswellマイクロアーキテクチャ|Haswell]] 世代 ===
全プロセッサ共通事項:プロセスルールは 22nm。
* '''マイクロアーキテクチャ''' - Haswell
* '''対応ソケット''' - [[Socket G3]] ([[PGA946|rPGA946B]]) or オンボード ([[BGA1364]] or [[BGA1168]])
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 2.0/3.0 対応
2,189 ⟶ 2,162行目:
=== [[Broadwellマイクロアーキテクチャ|Broadwell]] 世代 ===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Broadwell
* '''対応ソケット''' - オンボード ([[BGA1364]] or [[BGA1168]])
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 2.0/3.0 対応
2,303 ⟶ 2,276行目:
=== [[Skylakeマイクロアーキテクチャ|Skylake]] 世代===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
* '''対応ソケット''' - オンボード ([[BGA1440]] or [[BGA1356]])
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
2,445 ⟶ 2,418行目:
=== [[Kaby Lakeマイクロアーキテクチャ|Kaby Lake]] 世代===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
* '''対応ソケット''' - オンボード ([[BGA2270]] or [[BGA1440]] or [[BGA1356]] or [[BGA1515]])
* 発売時期(発表日 or 発売日) - Kaby Lake-G : 2018年1月 {{Flagicon|USA|name=米国時間}}、Kaby Lake-H : 2017年1月 {{Flagicon|USA|name=米国時間}}、Kaby Lake-U, Y : 2016年10月 {{Flagicon|USA|name=米国時間}}、Kaby Lake-R : 2017年7月 {{Flagicon|USA|name=米国時間}}、Amber Lake-Y : 2018年Q3 {{Flagicon|USA|name=米国時間}}
2,757 ⟶ 2,730行目:
=== [[Coffee Lakeマイクロアーキテクチャ|Coffee Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
* '''対応ソケット''' - オンボード ([[BGA1440]] or [[BGA1528]])
* 発売時期(発表日 or 発売日) - Coffee Lake-B, H, U : 2018年Q2 {{Flagicon|USA|name=米国時間}}、Coffee Lake-H Refresh : 2019年Q2 {{Flagicon|USA|name=米国時間}}、Whiskey Lake-U : 2018年Q3 {{Flagicon|USA|name=米国時間}}
2,968 ⟶ 2,941行目:
=== [[Comet Lakeマイクロプロセッサ|Comet Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
;Comet Lake-H
3,070 ⟶ 3,043行目:
=== [[Ice Lakeマイクロアーキテクチャ|Ice Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 10nm。
* '''マイクロアーキテクチャ''' - Sunny Cove
;Ice Lake-U
3,158 ⟶ 3,131行目:
=== [[Tiger Lakeマイクロアーキテクチャ|Tiger Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 10nm。
* '''マイクロアーキテクチャ''' - Willow Cove
;Tiger Lake-B
3,246 ⟶ 3,219行目:
! rowspan="3" |型番
! colspan="5" |CPU
! colspan="
! rowspan="3" |TDP<br />(W)
! rowspan="3" |対応メモリ
3,255 ⟶ 3,228行目:
! rowspan="2" |ブランド
! rowspan="2" |EU数
!
|-
! 定格
3,261 ⟶ 3,234行目:
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/217182.html 11390H]
3,270 ⟶ 3,245行目:
| rowspan="3" |Iris Xe<br />Graphics
| rowspan="3" |96
| || 1400
| rowspan="3" |35
| rowspan="3" |DDR4-3200<br />LPDDR4X-4266
3,276 ⟶ 3,251行目:
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/197384.html 11375H]
| rowspan="2" |3.3
|
| rowspan="2" |1350
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/196655.html 11370H]
| 4.8
|
|}
3,286 ⟶ 3,263行目:
|+ Tiger Lake-UP3
! rowspan="3" |型番
! colspan="
! colspan="
! rowspan="3" |TDP<br />(W)
! rowspan="3" |対応メモリ
|-
! rowspan="2" |コア数<br />(スレッド数)
!
! colspan="2" |キャッシュ (MB)
! rowspan="2" |ブランド
! rowspan="2" |EU数
!
|-
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/217187.html 1195G7]
| rowspan="3" |4 (8)
| || 5.0
| rowspan="3" |5
| rowspan="3" |12
| rowspan="3" |Iris Xe<br />Graphics
| rowspan="3" |96
| || 1400
| rowspan="3" |15
| rowspan="3" |DDR4-3200<br />LPDDR4X-4266
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/208664.html 1185G7]
| 1.8 || 4.8
| || 1350
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/208662.html 1165G7]
| 1.7 || 4.7
| || 1300
|}
3,325 ⟶ 3,306行目:
|+ Tiger Lake-UP4
! rowspan="3" |型番
! colspan="
! colspan="
! rowspan="3" |TDP<br />(W)
! rowspan="3" |対応メモリ
|-
! rowspan="2" |コア数<br />(スレッド数)
!
! colspan="2" |キャッシュ (MB)
! rowspan="2" |ブランド
! rowspan="2" |EU数
!
|-
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/208663.html 1180G7]
| rowspan="2" |4 (8)
| 1.3 || 4.6
| rowspan="2" |5
| rowspan="2" |12
| rowspan="2" |Iris Xe<br />Graphics
| rowspan="2" |96
|
| rowspan="2" |1100
| rowspan="2" |9
3,352 ⟶ 3,338行目:
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/208661.html 1160G7]
| 1.2 || 4.4
|
|}
=== [[Alder Lakeマイクロプロセッサ|Alder Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは Intel 7。
* '''マイクロアーキテクチャ'''
** '''Pコア''' - Golden Cove
** '''Eコア''' - Gracemont
;Alder Lake-HX
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-HX
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! colspan="2" |TDP (W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
! rowspan="3" |PBP
! rowspan="3" |MTP
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/228442.html 12850HX]
| rowspan="2" |8 (16)
| rowspan="3" |8 (8)
| 2.1
| rowspan="2" |4.8
| rowspan="3" |1.5
| rowspan="2" |3.4
| rowspan="2" |14
| rowspan="2" |25
| rowspan="3" |UHD<br />Graphics
| rowspan="3" |32
|
| rowspan="3" |1450
| rowspan="3" |55
| rowspan="3" |157
| rowspan="3" |DDR5-4800<br />DDR4-3200
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226058.html 12800HX]
| rowspan="2" |2.0
|
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/228795.html 12650HX]
| 6 (12)
| 4.7
| 3.3
| 11.5
| 24
|
|}
;Alder Lake-H
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-H
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! colspan="2" |TDP (W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
! rowspan="3" |PBP
! rowspan="3" |MTP
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226059.html 12800H]
| rowspan="3" |6 (12)
| rowspan="2" |8 (8)
| 2.4 || 4.8
| 1.8 || 3.7
| rowspan="2" |11.5
| rowspan="3" |24
| rowspan="2" |Iris Xe<br />Graphics
| rowspan="2" |96
|
| rowspan="3" |1400
| rowspan="3" |45
| rowspan="3" |115
| rowspan="3" |DDR5-4800<br />DDR4-3200<br />LPDDR5-5200<br />LPDDR4X-4266
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/132228.html 12700H]
| rowspan="2" |2.3
| rowspan="2" |4.7
| rowspan="2" |1.7
| rowspan="2" |3.5
|
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226066.html 12650H]
| 4 (4)
| 9.5
| UHD<br />Graphics
| 64
|
|}
;Alder Lake-P
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-P
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! colspan="2" |TDP (W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
! rowspan="3" |PBP
! rowspan="3" |MTP
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226253.html 1280P]
| 6 (12)
| rowspan="3" |8 (8)
| 1.8
| rowspan="2" |4.8
| 1.3 || 3.6
| 11.5
| 24
| rowspan="3" |Iris Xe<br />Graphics
| rowspan="3" |96
| || 1450
| rowspan="3" |28
| rowspan="3" |64
| rowspan="3" |DDR5-4800<br />DDR4-3200<br />LPDDR5-5200<br />LPDDR4X-4266
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226255.html 1270P]
| rowspan="2" |4 (8)
| 2.2
| 1.6 || 3.5
| rowspan="2" |9
| rowspan="2" |18
|
| rowspan="2" |1400
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226254.html 1260P]
| 2.1 || 4.7
| 1.5 || 3.4
|
|}
;Alder Lake-U
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-U
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! colspan="2" |TDP (W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
! rowspan="3" |PBP
! rowspan="3" |MTP
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226258.html 1265U]
| rowspan="4" |2 (4)
| rowspan="4" |8 (8)
| 1.8 || 4.8
| 1.3 || 3.6
| rowspan="4" |6.5
| rowspan="4" |12
| rowspan="4" |Iris Xe<br />Graphics
| rowspan="4" |96
|
| rowspan="2" |1250
| rowspan="2" |15
| rowspan="2" |55
| rowspan="2" |DDR5-4800<br />DDR4-3200<br />LPDDR5-5200<br />LPDDR4X-4266
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226259.html 1255U]
| 1.7
| rowspan="3" |4.7
| 1.2
| rowspan="3" |3.5
|
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226455.html 1260U]
| rowspan="2" |1.1
| rowspan="2" |0.8
|
| rowspan="2" |950
| rowspan="2" |9
| rowspan="2" |29
| rowspan="2" |LPDDR5-5200<br />LPDDR4X-4266
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226454.html 1250U]
|
|}
3,358 ⟶ 3,604行目:
=== [[Westmereマイクロアーキテクチャ|Westmere]] 世代 ===
全プロセッサ共通事項:プロセスルールは 32nm。
* '''マイクロアーキテクチャ''' - Westmere
* '''対応ソケット''' - オンボード ([[BGA1288]])
* 命令セット拡張 - SSE4.1/4.2、テクノロジー - Intel 64、XD bit、TBT 1.0、HT、EIST、API - DirectX 10.1、OpenGL 2.1、PCI Express 2.0 対応
3,417 ⟶ 3,663行目:
=== [[Sandy Bridgeマイクロアーキテクチャ|Sandy Bridge]] 世代 ===
全プロセッサ共通事項:プロセスルールは 32nm。
* '''マイクロアーキテクチャ''' - Sandy Bridge
* '''対応ソケット''' - [[Socket G2]] ([[PGA988|rPGA988B]]) or オンボード ([[BGA1023]])
* 命令セット拡張 - SSE4.1/4.2 AVX、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 2.0 対応
3,479 ⟶ 3,725行目:
=== [[Ivy Bridgeマイクロアーキテクチャ|Ivy Bridge]] 世代 ===
全プロセッサ共通事項:プロセスルールは 22nm。
* '''マイクロアーキテクチャ''' - Ivy Bridge
* '''対応ソケット''' - [[Socket G2]] ([[PGA988|rPGA988B]]) or オンボード ([[BGA1023]])
* 命令セット拡張 - SSE4.1/4.2 AVX、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
3,544 ⟶ 3,790行目:
=== [[Haswellマイクロアーキテクチャ|Haswell]] 世代 ===
全プロセッサ共通事項:プロセスルールは 22nm。
* '''マイクロアーキテクチャ''' - Haswell
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
* グラフィックス出力 - eDP/DP/HDMI/VGA、グラフィックス機能 - QSV/3D/WiDi/CVT HD対応、API - DirectX 11.1/11.2/12、OpenGL 4.0/4.3
3,654 ⟶ 3,900行目:
=== [[Broadwellマイクロアーキテクチャ|Broadwell]] 世代 ===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Broadwell
* '''対応ソケット''' - オンボード ([[BGA1364]])
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
3,708 ⟶ 3,954行目:
=== [[Skylakeマイクロアーキテクチャ|Skylake]] 世代===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
* 命令セット拡張 - SSE4.1/4.2 AVX 2.0、テクノロジー - Intel 64、XD bit、TBT 2.0、HT、EIST、PCI Express 3.0 対応
* グラフィックス出力 - eDP/DP/HDMI/DVI、グラフィックス機能 - 4K/QSV/3D/WiDi/CVT HD対応、API - DirectX 12、OpenGL 4.4
3,793 ⟶ 4,039行目:
=== [[Kaby Lakeマイクロアーキテクチャ|Kaby Lake]] 世代===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
;Kaby Lake-H
3,832 ⟶ 4,078行目:
=== [[Coffee Lakeマイクロアーキテクチャ|Coffee Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
;Coffee Lake-S
3,953 ⟶ 4,199行目:
=== [[Comet Lakeマイクロプロセッサ|Comet Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 14nm。
* '''マイクロアーキテクチャ''' - Skylake
* '''対応ソケット''' - [[LGA1200]]
3,998 ⟶ 4,244行目:
=== [[Tiger Lakeマイクロアーキテクチャ|Tiger Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは 10nm。
* '''マイクロアーキテクチャ''' - Willow Cove
;Tiger Lake-H
4,040 ⟶ 4,286行目:
! rowspan="3" |型番
! colspan="5" |CPU
! colspan="
! rowspan="3" |TDP<br />(W)
! rowspan="3" |対応メモリ
4,049 ⟶ 4,295行目:
! rowspan="2" |ブランド
! rowspan="2" |EU数
!
|-
! 定格
4,055 ⟶ 4,301行目:
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/208082.html 1185GRE]
4,064 ⟶ 4,312行目:
| rowspan="2" |Iris Xe<br />Graphics
| rowspan="2" |96
|
| rowspan="2" |1350
| rowspan="2" |15
4,069 ⟶ 4,318行目:
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/208076.html 1185G7E]
|
|}
=== [[Alder Lakeマイクロプロセッサ|Alder Lake]] 世代 ===
全プロセッサ共通事項:プロセスルールは Intel 7。
* '''マイクロアーキテクチャ'''
** '''Pコア''' - Golden Cove
** '''Eコア''' - Gracemont
;Alder Lake-S
* 対応ソケット: [[LGA1700]]
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-S
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! rowspan="4" |TDP<br />(W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |型番
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/132219.html 12700E]
| rowspan="2" |8 (16)
| rowspan="2" |4 (4)
| 2.1 || 4.8
| 1.6 || 3.6
| rowspan="2" |12
| rowspan="2" |25
| rowspan="2" |UHD 770
| rowspan="2" |32
| rowspan="2" |300
| rowspan="2" |1500
| 65
| rowspan="2" |DDR5-4800<br />DDR4-3200
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/132216.html 12700TE]
| 1.4 || 4.6
| 1.0 || 3.4
| 35
|}
;Alder Lake-H
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-H
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! colspan="2" |TDP (W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
! rowspan="3" |PBP
! rowspan="3" |MTP
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/226055.html 12800HE]
| 6 (12)
| 8 (8)
| 2.4 || 4.6
| 1.8 || 3.5
| 11.5
| 24
| Iris Xe<br />Graphics
| 96
| || 1350
| 45 || 115
| DDR5-4800<br />DDR4-3200<br />LPDDR5-5200<br />LPDDR4X-4266
|}
;Alder Lake-P
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-P
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! colspan="2" |TDP (W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
! rowspan="3" |PBP
! rowspan="3" |MTP
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/132217.html 1270PE]
| 4 (8)
| 8 (8)
| 1.8 || 4.5
| 1.2 || 3.3
| 9
| 18
| Iris Xe<br />Graphics
| 96
| || 1350
| 28 || 64
| DDR5-4800<br />DDR4-3200<br />LPDDR5-5200<br />LPDDR4X-4266
|}
;Alder Lake-U
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-U
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! colspan="2" |TDP (W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
! rowspan="3" |PBP
! rowspan="3" |MTP
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/227853.html 1265UE]
| 2 (4)
| 8 (8)
| 1.7 || 4.7
| 1.2 || 3.5
| 6.5
| 12
| Iris Xe<br />Graphics
| 96
| || 1250
| 15 || 55
| DDR5-4800<br />DDR4-3200<br />LPDDR5-5200<br />LPDDR4X-4266
|}
;Alder Lake-PS
* 対応ソケット: [[LGA1700]]
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-PS
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! rowspan="4" |TDP<br />(W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/229953.html 12800HL]
| rowspan="2" |6 (12)
| rowspan="2" |8 (8)
| 2.4 || 4.8
| 1.8 || 3.7
| rowspan="2" |11.5
| rowspan="2" |24
| rowspan="2" |Iris Xe<br />Graphics
| rowspan="2" |96
|
| rowspan="2" |1400
| rowspan="2" |45
| rowspan="2" |DDR5-4800<br />DDR4-3200
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/228459.html 12700HL]
| 2.3 || 4.7
| 1.7 || 3.5
|
|}
{| class="wikitable" style="text-align:center; font-size:85%"
|+ Alder Lake-PS
! rowspan="4" |型番
! colspan="8" |CPU
! colspan="4" |GPU
! rowspan="4" |TDP<br />(W)
! rowspan="4" |対応メモリ
|-
! rowspan="2" colspan="2" |コア数<br />(スレッド数)
! colspan="4" |クロック (GHz)
! rowspan="2" colspan="2" |キャッシュ<br />(MB)
! rowspan="3" |ブランド
! rowspan="3" |EU数
! rowspan="2" colspan="2" |クロック<br />(MHz)
|-
! colspan="2" |Pコア
! colspan="2" |Eコア
|-
! Pコア
! Eコア
! 定格
! ターボ
! 定格
! ターボ
! L2
! L3
! 定格
! ターボ
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/230905.html 1265UL]
| rowspan="2" |2 (4)
| rowspan="2" |8 (8)
| 1.8 || 4.8
| 1.3 || 2.7
| rowspan="2" |6.5
| rowspan="2" |12
| rowspan="2" |Iris Xe<br />Graphics
| rowspan="2" |96
|
| rowspan="2" |1250
| rowspan="2" |15
| rowspan="2" |DDR5-4800<br />DDR4-3200
|-
|[https://www.intel.co.jp/content/www/jp/ja/products/sku/230904.html 1255UL]
| 1.7 || 4.7
| 1.2 || 2.6
|
|}
|