Logica PMOS: differenze tra le versioni

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La '''logica PMOS''' si basa sulla logica inversa di [[Logica NMOS|quella NMOS]].
 
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Tensione HIGH -> per un livello logico di tensione di Gate basso (0)
{{Portale|informatica|elettrotecnica}}
 
[[Categoria:Transistor ad effetto di campo]]
[[Categoria:Famiglie logiche]]
{{Portale|Informatica|Elettrotecnica}}