Intel QuickPath Interconnect: differenze tra le versioni
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{{F|informatica|aprile 2010}}
Con il nome di '''Intel QuickPath Interconnect''' o '''QPI''' (precedentemente conosciuto come '''Common Systems Interconnect''' o '''CSI''') [[Intel]] indica un nuovo tipo di [[
Si tratta di un nuovo tipo di BUS di comunicazione che ha fatto il suo debutto sul mercato grazie ai primi processori basati sulla nuova architettura [[Nehalem (hardware)|Nehalem]] (successiva alla [[Intel Core Microarchitecture]]) e conosciuti come [[Core i7]] [[Bloomfield (microprocessore)|Bloomfield]], ma che successivamente verrà estesa anche al settore server della linea [[IA-64]] per il quale Intel sta sviluppando il futuro [[Itanium 2]] [[Tukwila (hardware)|Tukwila]].
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Lo scopo di Intel, grazie anche all'adozione del nuovo BUS QPI, è quello di standardizzare l'interfaccia dei processori [[IA-32]] e [[IA-64]] attraverso la "[[Common Platform Architecture]]" (CPA), una tecnologia che renderà Itanium e [[Xeon]] "intercambiabili". Intel promette che nel futuro sarà possibile sostituire un processore Xeon con un Itanium 2 sulla stessa piattaforma [[hardware]] senza la necessità di altri interventi.
Ad accompagnare Tukwila come primo chip Intel con controller di memoria integrato sul fronte Itanium 2, doveva essere [[Whitefield (hardware)|Whitefield]] sul fronte Xeon, il cui sviluppo però è stato interrotto il [[25 ottobre]] [[2005]] per motivi non meglio precisati da parte di Intel. A prendere il suo posto è stato [[Tigerton (hardware)|Tigerton]] che include una connessione diretta dal [[chipset]] ad ogni singolo processore ma non il nuovo BUS seriale che è arrivato solo con l'architettura [[Nehalem (hardware)|Nehalem]], il cui primo esponente nel panorama Xeon MP sarà molto probabilmente [[Beckton]]. Tra i moltissimi obiettivi di Intel vi è anche quello di parificare i costi dell'hardware Itanium e Xeon, in questo modo gli utenti avranno la libertà di decidere quale architettura scegliere.
== Caratteristiche tecniche ==
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